LoGin
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bd70d2d1f4
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chore: 将工具链更新到2024-07-23 (#864)
* chore: 将工具链更新到2024-07-23
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2024-07-25 00:55:02 +08:00 |
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曾俊
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2eab6dd743
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feat(log): 将内核日志统一为新的logger (#814)
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2024-05-16 17:25:23 +08:00 |
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LoGin
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0102d69fdd
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feat:(riscv/intr) 实现riscv plic驱动,能处理外部中断 (#799)
* feat:(riscv/intr) 实现riscv plic驱动,能处理外部中断
- 实现riscv plic驱动,能处理外部中断
- 能收到virtio-blk的中断
- 实现fasteoi interrupt handler
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2024-05-01 21:11:32 +08:00 |
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LoGin
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f049d1af01
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初始化riscv-sbi-timer (#716)
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2024-04-12 14:46:47 +08:00 |
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LoGin
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b5b571e026
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修复内核的clippy检查报错 (#637)
修复内核的clippy检查报错
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Co-authored-by: Samuel Dai <947309196@qq.com>
Co-authored-by: Donkey Kane <109840258+xiaolin2004@users.noreply.github.com>
Co-authored-by: themildwind <107623059+themildwind@users.noreply.github.com>
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Co-authored-by: 曾俊 <110876916+ZZJJWarth@users.noreply.github.com>
Co-authored-by: sun5etop <146408999+sun5etop@users.noreply.github.com>
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Co-authored-by: Samuel Dai <samuka007@qq.com>
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2024-03-22 23:26:39 +08:00 |
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LoGin
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338f690326
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riscv: 初始化irq (#560)
完成riscv的irqchip初始化的代码。
这是该功能的第一个PR。由于还需要实现timer驱动才能测试，因此该功能将会通过2~3个PR来完成。
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2024-03-05 17:22:04 +08:00 |
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LoGin
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e28411791f
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完成中断管理模块重构 (#554)
- 支持中断共享
- 把现有驱动程序移植到新的irq模块
- 使用`ProcessorId`标识处理器id
- 尚未实现threaded_irq
性能上，edge irq flow handler里面，对于锁的使用，可能有点问题。为了获取/修改common data还有其他几个结构体的状态，进行了多次加锁和放锁，导致性能降低。这是接下来需要优化的点。
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2024-03-03 16:31:08 +08:00 |
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LoGin
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3bc96fa4a9
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添加irqdesc的抽象，并在系统初始化时创建irqdesc (#522)
* 添加irqdesc的抽象，并在系统初始化时创建irqdesc
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2024-02-19 00:36:36 +08:00 |
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LoGin
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ce5850adbf
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添加irqchip这一层的数据结构(尚未接入真实的芯片) (#520)
* 添加irqchip这一层的数据结构(尚未接入真实的芯片)
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2024-02-18 20:41:41 +08:00 |
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